¿Qué se espera de un muy buen ingeniero de verificación ASIC?

No es solo aprender metodología o conocer un protocolo lo que hace un buen ingeniero de verificación. Esas son solo dos habilidades que lo ayudarán a corto plazo para su trabajo, pero necesita tener una visión más amplia para el éxito a largo plazo.

Basado en mi experiencia de más de una década como ingeniero de verificación, lo que he aprendido y lo que he observado como rasgos de varios ingenieros de verificación exitosos y excepcionales, trataré de enumerar algunos de los puntos

  1. Conocimiento sólido sobre el diseño bajo prueba (DUT) : ya sea que esté trabajando en un protocolo de verificación de IP o en una o más partes de diseños complejos como una CPU / chip de red / chip inalámbrico: debe comprender todos los aspectos de la especificación de diseño. Este conocimiento es lo que lo ayudará en varios otros aspectos clave de la verificación, como:
    1. Definir un plan de verificación adecuado e identificar todas las características y casos de esquina para la prueba
    2. Identificar la metodología correcta para diferentes características: algunas pueden verificarse mejor con simulación, mientras que otras pueden ser ideales para verificación formal o emulación, etc.
    3. Diseño e implementación de bancos de pruebas eficientes: definición de estímulos, controladores, verificadores, cobertura, etc.
    4. Depuración de fallas de simulación, identificación de errores, propuesta de arreglos, etc.
    5. Definición de cobertura y otras métricas para completar la verificación
  2. Desarrollo de habilidades de depuración: sea persistente La depuración será su parte del trabajo diario. Ya sea que esté desarrollando un banco de pruebas, simulando una prueba, analizando una cobertura, observando fallas de regresión, etc., deberá ser persistente en la depuración y llegar a la causa raíz cada vez. Su sólido conocimiento del diseño ayudará mucho en esto y una vez que domine esto, creo que todas las demás habilidades mejorarán. La automatización de cualquier tarea repetitiva también hará que las depuraciones sean más eficientes.
    1. La siguiente es una diapositiva del blog de Mentor (Metodología de verificación “BLOG de horizontes de verificación”) que muestra que un ingeniero de verificación pasa la mayor parte del tiempo en depuración

  1. Habilidades de programación, conocimiento de metodologías de verificación.
    1. Se espera una buena comprensión de los conceptos de programación y un lenguaje de verificación como SystemVerilog y una metodología como OVM / UVM de un ingeniero de verificación. Sin embargo, estas son habilidades que se siguen aprendiendo y con una actitud correcta que se pueden dominar con práctica y práctica.
  2. Otros rasgos diversos que lo ayudarán a tener éxito son
    1. Trabajando estrechamente con ingenieros de diseño, desarrolle curiosidad, haga preguntas, sugiera soluciones
    2. Trabajando hacia la mejora continua y la alta calidad: siempre trate de mejorar sus habilidades sin sacrificar la calidad: altos estándares de codificación, paranoico de cada falla, etc.
    3. Capacidad para comunicarse e informar de manera efectiva los problemas a los compañeros y al equipo con detalles bien entendidos
    4. Priorización de tareas y riesgos, ya que no todo se puede hacer siempre en un momento dado.

Lea también esta publicación de blog ¿Qué hace que un gran ingeniero de verificación en la industria VLSI? por Ramdas Mozhikunnath en Verification Excellence – Aprenda, Excel y avance en la verificación funcional

Para responder a la pregunta: debe ser bueno en todos los tres aspectos mencionados anteriormente.

Primero veamos el aspecto de la metodología:

Metodología como lo que he entendido son pautas para construir su entorno de verificación. HVL cambió la forma en que se resolvió el problema de verificación funcional. Cada ingeniero tiene su estilo de usar el HVL y resolver el problema de verificación. Sin embargo, para una buena solución de verificación es necesario tener en cuenta factores como la escalabilidad y la reutilización. Entonces, las metodologías abordan estos problemas pidiéndole al usuario que siga ciertas pautas definidas como parte de la metodología.

Entonces, sí, si desea ser un buen ingeniero de verificación, necesita conocer la metodología y comprender qué está tratando de resolver cada característica.

A continuación, veamos el conocimiento del protocolo.

Es posible que escuche que la experiencia en protocolos no es muy importante, pero por mi experiencia relativamente joven en el dominio de verificación, puedo decir que es de gran ayuda.
Según su conocimiento de protocolo, puede separar claramente los problemas del banco de pruebas de los errores de diseño reales. También ayuda durante los debates con los diseñadores a decidir si es un error o no. También ayuda a descubrir escenarios de esquina / complicados donde a veces las especificaciones no están claramente definidas.

El tercer aspecto de la pregunta con respecto a los escenarios de esquina, esto proviene tanto de la experiencia como del protocolo. Con experiencia, podrá observar ciertos problemas de verificación con más cuidado y darles una importancia adicional.

Espero que esto ayude a responder tu pregunta.

El conocimiento del protocolo es crucial para el éxito de cualquier ingeniero de verificación ASIC. Uno puede aprender cualquier metodología de verificación en un tiempo razonablemente menor si es experto en verilog de sistema. La experiencia en protocolos estándar de la industria [PCIe, Ethernet, USB, SATA, HDMI, etc.] puede asegurar una buena carrera, siempre con buenas habilidades de pensamiento lógico y programación.

La industria de verificación ASIC busca …

Aquellos que tienen experiencia en la verificación a nivel de unidad y la verificación de SoC con comando en el protocolo estándar de la industria como PCIe, Ethernet, USB, etc.

Aquellos que tienen el mando en el trabajo de entornos de verificación verde y heredados.

Aquellos que son maestros en la construcción de entornos de prueba verdaderamente escalables y reutilizables.

Buenos fundamentos digitales

SV / UVM es imprescindible

Buenas habilidades de depuración.

Comprensión del flujo ASIC

Verilog es bueno tener

Experiencia laboral en AXI3 / 4 y AHB, además de algunos otros protocolos es ventajoso

Algunos pueden pedir conocimiento sobre C, aunque no es obligatorio.

GLS bueno tener

Conocimiento sobre PERL / TCL

RAL no es necesario pero es bueno tener

El cuerpo de su pregunta me hace pensar que no está abordando la tarea correctamente. Un ingeniero de verificación necesita comprender la situación para hacer las preguntas correctas. Necesitará saber un poco de todo, y cada situación puede requerir un conjunto diferente de fortalezas.

Muchas veces veo que los ingenieros reducen su enfoque demasiado pronto y pierden el panorama general. Esto lo lleva a ciertos caminos y no puede ver otros caminos más productivos.

Sé que esta respuesta parece un poco vaga, pero eso es lo que obtienes por hacer una pregunta vaga.

Depende de si está solicitando la verificación RTL o la verificación física. Si está preguntando acerca de la verificación RTL, entonces debe tener un sólido concepto de OOP, comando en SV y un buen conocimiento de los protocolos de comunicación más utilizados como PCI, bus AXI, etc. Si está buscando verificación física, es un juego de pelota completamente diferente en el que necesita tener fundamentos sólidos de CMO, familiaridad con DRC, LVS y herramientas de cierre de sesión de Synopsys (Hercules) o Cadence.

Para cualquier otra consulta contácteme en [correo electrónico protegido]

Enlace del blog: http://www.vlsirecipes.com

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